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一種新的嵌入式處理器在線調(diào)試方法

  • 　　引言　　在FPGA 設(shè)計中使用嵌入式處理器軟核( 如MicroBlaze、PicoBlaze 等) 構(gòu)成可編程片上系統(tǒng)( SystemOn Programmable Chip，SOPC) ，相比于ASIC 具有更好的可修改性和可維護性，得到了普遍的應(yīng)用。由于ARM，MicroBlaze 等大型處理器內(nèi)核具備調(diào)試接口，在與之對應(yīng)的調(diào)試模塊配合下，調(diào)試軟件可以通過JTAG 接口實現(xiàn): 執(zhí)
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充分發(fā)揮PicoBlaze微控制器的優(yōu)勢

  • 眾多FPGA 應(yīng)用均可通過使用簡單的軟核處理器來簡化時序控制結(jié)構(gòu)的生成，從而深受其益。作者：Adam P. Taylore2v公司工程系統(tǒng)負責(zé)人aptaylor@theiet.orgPicoBlaze 是一款結(jié)構(gòu)緊湊的8 位軟核微控制器，F(xiàn)PGA工程師可在
  • 關(guān)鍵字： PicoBlaze    軟核  

KCPSM6 PicoBlaze的原理與應(yīng)用

  • KCPSM6 PicoBlaze的原理與應(yīng)用,引言
    PicoBlaze 8位嵌入式處理器是Xilinx公司為Virtex、Spartan系列FPGA和CoolRunner—II系列CPLD設(shè)計的嵌入式處理器軟核。針對不同的器件，Xilinx公司共推出了3個版本的PicoBlaze，包括KCPSM3(目標(biāo)器件為
  • 關(guān)鍵字： 應(yīng)用  原理  PicoBlaze  KCPSM6  

PicoBlaze軟核的仿真與調(diào)試

  • 引言PicoBlaze是Xilinx公司為Virtex、Spartan系列FPGA和CoolRunnerII系列CPLD設(shè)計的8位嵌入式處理器軟核。PicoBlaze嵌入式處理器具有高達44～100 MIPS的指令執(zhí)行速度，并具有效率高、占用資源少等優(yōu)點，可以方便地嵌
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基于FPGA的Picoblaze核實現(xiàn)Modbus通信協(xié)議

  • 摘要：給出了一種在Xinlinx的Spartan-3E評估板上實現(xiàn)Modbus通信協(xié)議的方法。該方法以PC為上位機，并在評估板上嵌入Picoblaze軟核作為下位機來實現(xiàn)Modbus通信協(xié)議的功能。文中同時介紹了使用Xilinx ISE和Picoblaze軟核
  • 關(guān)鍵字： 通信  協(xié)議  Modbus  實現(xiàn)  FPGA  Picoblaze  基于  

基于PicoBlaze軟核的TFT液晶顯示控制

  • 基于PicoBlaze軟核的TFT液晶顯示控制,摘要：介紹基于8位嵌入式軟核PicoBlaze的SOPC的設(shè)計方法，提出一種基于PicoBlaze軟核的TFT液晶顯示控制方案，并給出了軟硬件設(shè)計方法。實驗結(jié)果表明，該方案占用資源少，運行速度快，可以為FPGA驅(qū)動TFT液晶提供設(shè)計參
  • 關(guān)鍵字： 液晶顯示  控制  TFT  軟核  PicoBlaze  基于  

ML7204和PicoBlaze軟核處理器實現(xiàn)低速話音編解碼系統(tǒng)

  • 語音信號壓縮編碼是數(shù)字語音信號處理的主要方面，在現(xiàn)有的語音編碼中，G．729A算法在8 kb／s的碼率下取得了較好的語音質(zhì)量，具有廣闊應(yīng)用前景，因此提出采用PicoBlaze和ML7204實現(xiàn)G．729A語音壓縮／解壓詳細的軟硬件實現(xiàn)方案，并描述了G．729A語音編解碼器ML7204的工作原理、性能、接口，以及FPGA內(nèi)嵌IP核微處理器PicoBlaze的特點和使用方法。給出硬件電路設(shè)計原理，以及各部分的具體實現(xiàn)方法和原理圖。并給出軟件流程和主要代碼。實驗結(jié)果表明，系統(tǒng)提供話音點到點的時延僅為25 ms，
  • 關(guān)鍵字： 話音  解碼  系統(tǒng)  低速  實現(xiàn)  PicoBlaze  軟核  處理器  ML7204  編解碼器  

PicoBlaze處理器IP Core的原理與應(yīng)用

  • 詳細分析8位微處理器IP core PicoBlaze的結(jié)構(gòu)、原理與設(shè)計方案。
  • 關(guān)鍵字： PicoBlaze  Core  處理器IP  原理    
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